Evd Electronic A Digital

  • October 2019
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  • Words: 1,025
  • Pages: 16
Regional Distrito Capital Centro de Gestión de Mercados, Logística y Tecnologías de la Información

MANTENIMIENTO DE HARDWARE

Regional Distrito Capital Sistema

Centro de Gestión de Mercados, Logística y

de Gestión de la Calidad

Tecnologías de la Información

MANTENIMIENTO DE HARDWARE

Centro Gestión Comercial y Mercadeo Programa de Teleinformática Agosto 30 del 2008

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Tecnologías de la Información

MANTENIMIENTO DE HARDWARE

Control del Documento

Nombre

Autores

Erika

Cargo Marcela

Quiñonez Calvache

Dependencia Centro de Gestión de

Alumno

Mercados,

Logística Tecnologías

de

Revisión

Ing. Jhon Pérez

tor

de

Tecnologías Información

de

la

2008

y de

30

Agosto de

Mercados,

Logística

Fecha

y

Información Centro de Gestión Instruc

Firma

la

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Evidencia electrónica digital

Practica Nº 1

1. Rellenar Representar los diagramas de tiempo que se obtienen como respuesta al estado del Pulsador A de entrada al inversor.

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2. Si la patilla 1 del 7404 queda al aire (sin conexión), indicar cuál será el nivel lógico de la patilla 2. Razone su respuesta y comprobarla.

Rta: Si la patilla 1 del 7404 queda sin conexión, no entraría voltaje (0) a la compuerta y el nivel de la patilla 2 seria (1).

3. Si la patilla 2 del 7404 tiene un nivel lógico cero, indicar las tensiones existentes en las patillas a y 14 del mismo.

Rta: La tensión de la patilla 14 seria 5V.

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Practica N°2

1. Si la patilla del circuito integrado se cortocircuita a tierra, indicar el nivel lógico de la patilla 10 de salida del montaje de la figura anterior. (arriba).

Rta: la tensión de la patilla numero 10 depende de la tensión que entre en la patilla numero 9 si entran 0 voltios en la patilla 9 la tensión de la patilla 10 serian 5 voltios, pero si en la patilla 9 entran 5 voltios la patilla 10 la tensión seria 0 voltios.

2. ¿Se nota a simple vista, algún retardo en la propagación del estado lógico a lo largo de los inversores en serie. ? Indicar el tiempo de retardo en un circuito integrado TTL estándar.

Rta: Si hay un retardo a simple vista.

3. Rellenar el diagrama de tiempos correspondiente al pulsador A, mostrado en la siguiente figura:

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4S 1 / 6 del 7404 Salida 2

T 3

4

5U

6

7 V

W

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PRACTICA N°3

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Salida 312Entradas T S B A / 4 del 7408

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Esquema del montaje.-

1. Alimentación de un integrado por 7 ( - ) y el pin 14 ( + ).

2.

Cuando el interruptor está abierto, se toma el 1 lógico.

3.

Cuando el interruptor está cerrado, se tiene el 0 lógico.

4. Se saca la tabla de verdad.

Rta:

A 1 1 0

B 1 0 1

S 1 0 0

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0

0

0

PRACTICA N° 4

1. Obtener la ecuación lógica a la que el esquema de la figura anterior responde.

Rta: La ecuación lógica es ABCD 1111.

2. Si el interruptor C se avería e introduce siempre a un nivel lógico bajo, indicar en qué ocasiones se enciende el led señalizador U.

Rta:Si el interruptor C se avería nunca se encendería el LED.

3. Completar el diagrama de los tiempos de las siguientes figuras.

Rta:

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PRACTICA N° 5

1. Rellenar la tabla de verdad de la siguiente figura, comprobando el resultado en la práctica.

A

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0 0 1 1

B

S

0 1 0 1

1 0 1 1

2. Indicar el estado de S si las patas 4 y 5 quedan al aire. Deducir la respuesta.

Rta: Si las patas 4 y 5 quedan al aire S enciende.

3. Con una puerta NOR y los inversores que se deseen, dibujar el diagrama lógico al que esquema de la figura superior perteneciente al esquema de montaje responde.

4. Si se cortocircuitan entre sí las patillas 4 y 5 del circuito integrado 7400, ¿Cuál será el estado de lógico de S?

Rta: Si 4 y 5 quedan al aire S enciende.

PRACTICA N°6

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1. Obtener la formula lógica simplificada a la que el esquema o la figura anterior responde.

Rta:

2. En qué casos S y T poseen el mismo estado lógico.

Rta: En ningún caso poseen el mismo estado lógico.

3. Completar el diagrama de tiempos de la siguiente figura, al mismo tiempo que se va implementando en la práctica.

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